(1)Square-D FAL-36050復(fù)位問(wèn)題。當(dāng)FPGA一上電時(shí)，其內(nèi)部的PLC邏輯即令其自身進(jìn)入了一個(gè)自復(fù)位狀態(tài)。此時(shí)如果沒(méi)有外部MCU給予正確的操作指令。FPGA將不會(huì)進(jìn)入其他任何狀態(tài)。從而確保PLC不會(huì)產(chǎn)生任何的誤動(dòng)作。
(2)Square-D FAL-36050響應(yīng)時(shí)間。PLC程序會(huì)得到周而復(fù)始的執(zhí)行，當(dāng)輸入狀態(tài)(in image)改變時(shí)，輸出狀態(tài)會(huì)在下一個(gè)允許輸出信號(hào)有效時(shí)(outputfresh=1)得到更新。PLC的最大響應(yīng)周期取決于所執(zhí)行的指令條數(shù)。對(duì)于絕大多數(shù)指令而言。PLC可在每個(gè)時(shí)鐘周期執(zhí)行一條語(yǔ)句。在最后一條語(yǔ)句執(zhí)行完成后的下一個(gè)時(shí)鐘上升沿輸出得到刷新，同時(shí)在此刷新時(shí)鐘周期內(nèi)。PLC進(jìn)行循環(huán)復(fù)位的初始化工作。最差的情況時(shí)。輸入信號(hào)在上次采集剛剛結(jié)束后發(fā)生Square-D FAL-36050變化。需要在下一次采樣并執(zhí)行完成后才能反映到輸出上。即響應(yīng)時(shí)間為T(mén)response=(PLC指令條數(shù)+1)×2×?xí)r鐘周期，本文使用的時(shí)鐘周期為50ns，因此有：Tresponse=(PLC指令條數(shù)+1)×2×50ns：受FPGA內(nèi)部的EAB(Embedded Arrav B10ck。一種專(zhuān)門(mén)用來(lái)綜合成RAM的內(nèi)部資源)數(shù)量的限制。只能綜合出約2k bvte RAM(除非設(shè)置必要的控制寄存器)。當(dāng)執(zhí)行約有2 000條PLC指令時(shí)。最大響應(yīng)時(shí)間為0。2ms量級(jí)。Square-D FAL-36050
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