OMRON CJ1W-DRM21基于PSoC4的設(shè)計(jì)實(shí)例
1）原理圖設(shè)計(jì)
根據(jù)圖4的控制框圖，我們?cè)O(shè)計(jì)了圖5及圖6所示的BLDC控制原理圖。
三相端電壓通過(guò)IO與內(nèi)部模擬多路選擇器相連，模擬多路選擇器會(huì)根據(jù)換相狀態(tài)動(dòng)態(tài)的切換所要采樣的非通電相并連接至片內(nèi)比較器。片內(nèi)的比較器與母線電壓的一半比較，輸出信號(hào)連接至D觸發(fā)器的輸入端。D觸發(fā)器的的時(shí)鐘信號(hào)來(lái)自于數(shù)字模塊中的PWM模塊的輸出。 這樣通過(guò)D觸發(fā)器可獲得在PWM為高電平的時(shí)刻端電壓與半母線電壓的比較結(jié)果。而比較器的翻轉(zhuǎn)時(shí)刻即是反電勢(shì)過(guò)零點(diǎn)。比較器的輸出翻轉(zhuǎn)時(shí)，可以觸發(fā)中斷，通知CPU作相應(yīng)的處理。同時(shí)片上的比較器還具有滯回比較的功能。即比較器輸出器自上而下翻轉(zhuǎn)與自上而下翻轉(zhuǎn)的電壓并不完全一致，而是有一個(gè)10mV左右的滯回電壓。此功能可以避免比較器輸出受毛刺影響而被誤觸發(fā)。
OMRON CJ1W-DRM21 基于PSoC 4的無(wú)傳感器BLDC控制
圖5 過(guò)零點(diǎn)檢測(cè)原理圖
在過(guò)零點(diǎn)中斷中，CPU可直接通過(guò)控制寄存器控制UDB換相邏輯表LUT直接驅(qū)動(dòng)三相全橋電路，完成電機(jī)的硬件換相。同時(shí)換相信號(hào)也同步輸入至定時(shí)器，完成電機(jī)速度檢測(cè)。
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OMRON CJ1W-DRM21 DEVICENET UNIT
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WESTINGHOUSE 1541A29G01 USPP 1541A29G01
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Details about DODGE 2012-1-7/16 NSFP 20121716
RELIANCE ELECTRIC 67525-B USPP 67525B
Details about ITE SIEMENS QP1B030 USPP QP1B030
Details about FURNAS ELECTRIC CO 3RV1913-4C NSFP 3RV19134C
WESTINGHOUSE NL-733H NSFP NL733H
Details about WILKERSON PNEUMATIC R00-01-000 NSFP R0001000
Details about YALE 580084983 NSPP 580084983
WESTINGHOUSE BFF53F USPP BFF53F
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