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本系統(tǒng)采用基于FPGA與DSP協(xié)同工作進行視頻處理的方案，實現(xiàn)視頻采集、處理到傳輸?shù)恼麄€過程。
　　CPU-40B/4實時視頻圖像處理中，低層的預處理算法處理的數(shù)據(jù)量大，對處理速度要求高，但算法相對比較簡單，適合于用FPGA進行硬件實現(xiàn)，這樣能兼顧速度及靈活性。高層的處理算法結構復雜，適用于運算速度高、尋址方式靈活、通信機制強的DSP芯片宋實現(xiàn)。
　　DSP+FPGA架構的最大特點是結構靈活、有較強的通用性、適合于模塊化設計，從而能夠提高算法效率，同時其開發(fā)周期短、系統(tǒng)易于維護和升級，適合于實時視頻圖像處理。
　　系統(tǒng)采用模塊化的設計方法，將整個系統(tǒng)劃分為三部分：視頻采集單元、視頻處理單元和視頻傳輸單元。
　　CPU-40B/4整個系統(tǒng)以FPGA作為核心控制單元并完成視頻信號的中值濾波工作;以DSP作為整個系統(tǒng)的核心處理單元對采集的視頻圖像信息進行JPEG壓縮;在視頻傳輸單元設計了以PDIUSBD12芯片為基礎的USB總線，負責視頻信號的傳輸。
　　1系統(tǒng)硬件總體架構
　　CPU-40B/4一個完整的視頻處理系統(tǒng)，主要由視頻采集單元、視頻處理單元及視頻傳輸單元三部分組成。在進行系統(tǒng)設計時須確保各部分的無縫銜接。
　　圖像采集單元由FPGA和MB86S02視頻采集芯片組成，包括視頻信號的采集和預處理，把輸入的視頻信號轉換成系統(tǒng)能夠處理的數(shù)字圖像數(shù)據(jù)，并按照一定的格式存儲在確定的存儲區(qū)域。
　　圖像處理單元是本系統(tǒng)的核心，對圖像數(shù)據(jù)進行壓縮處理，實現(xiàn)系統(tǒng)要達到的功能。
　　圖像傳輸單元采用FPGA+USB的方式實現(xiàn)視頻數(shù)據(jù)的傳輸，通過基于PDIUSBD12芯片的USB總線，將壓縮后的視頻圖像信息發(fā)送到接收端，在接收端使用在PC上編寫的應用程序將圖像解壓縮并顯示出來。
　　CPU-40B/4整個硬件系統(tǒng)由FPGA和DSP兩個分系統(tǒng)組成，F(xiàn)PGA作為視頻采集單元，將采集到的視頻信號預處理后傳給DSP，DSP作為圖像處理單元是本系統(tǒng)的核心，對FPGA預處理后的視頻圖像信息進行JPEG壓縮處理，DSP單元的性能決定著整個系統(tǒng)的性能，DSP完成圖像處理任務后，將把結果返回給 FPGA，F(xiàn)PGA將經過壓縮處理后的圖像信息寫入接口控制芯片的數(shù)據(jù)緩沖區(qū)，由接口控制芯片負責信息的傳輸，系統(tǒng)總體框圖如圖1所示。

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CPU-40B/4
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